Actel Libero IDE v8.3 SP1 Windows 英文正式版(FPGA產品設計)(DVD版)
破解說明:
1.請詳讀SHooTERS資料夾中readme.txt
內容說明:
為了擴展其業界領先的專門針對晶片級和系統級節省功率的解決方案，Actel公司宣佈
推出全新版本Libero集成設計環境(IDE)，具備嶄新的重要功能包括功率驅動佈局，使
設計人員得以進一步優化設計，並可減少典型設計的動態功耗達30%。通過在Libero的
SmartPower工具中內置先進的功耗分析功能，這個強化的分析環境將可首次讓用戶在
設計的所有功能模式下深入瞭解其功率應用。此外，便攜產品設計人員更可透過其創
新的電池壽命評估功能，以其FPGA設計的功耗曲線為基礎，精確計算出電池壽命 —
這是首次在現場可編門陣列(FPGA)設計工具中實現的功能。
Actel軟體工程副總裁Jim Davis稱：「儘管整個電子行業在提供高功效晶片和系統方
面取得了進展，Actel的解決方案無疑為低功耗應用奠下了標準。通過在Libero IDE
v8中加入先進的佈局優化和功率分析功能，設計人員能夠更有效地實現最低功耗的解
決方案。」
新版本Libero IDE支援Actel所有的低功耗產品系列，包括超低功耗IGLOO FPGA和混合
信號Actel Fusion可編程系統級晶片(PSC)。
功率驅動佈局功能降低動態功耗達30%
全新Libero IDE的一個新選項是積極發揮SmartPower中用於功率驅動佈局的設計分析
數據，使設計人員能夠通過減少網路的容性負裁，快速實現動態功耗的節省。IGLOO器
件的功耗能平均降低13%，而一些設計更能降低功耗達30%。
電池壽命評估功能為電池供電的便攜產品設計人員提供協助
在Libero IDE v8中，SmartPower功能為設計人員提供了創建功率曲線的能力，有助於
估算所需的電源和電池要求。功率曲線由用戶定義，是FPGA在定制或功能模式組合下
的時間百分比，比如活動、待機或
flash*Freeze模式。舉例說，為了提供便攜或手持
設計的電池壽命評估，用戶可輸入所需的電池電流容量及FPGA的功率曲線，
SmartPower便會顯示出預計的電池壽命，以及基於目標FPGA的真正功率曲線的實際準
確的功耗報告。
增強的SmartPower分析功能實現便攜設計的高功效
Libero IDE v8.還增強了SmartPower的功能，能夠分析整個FPGA及器件或設計特定部
分的功耗，如時域、開關週期，以及假性轉換(spurious transition)，而這些因素會
個別增加器件的總體功耗。例如，一個精確週期的功率分析選項可讓設計人員查看每
個時鐘週期的峰值功耗，以及整個仿真過程的平均功耗。
SmartPower工具的開關分析選項能夠確定引起功耗增加的「危險」，或假性轉換狀況
，讓用戶找出這些問題並加以修正，從而降低功耗。在典型的設計中，危險狀況佔據
了約20%的功耗。在某些電路中，如組合加法器邏輯，假性轉換引起的功耗有可能高達
總體功耗的70%。
Actel's Flagship FPGA Development Software Libero Integrated Design
Environment (IDE) is Actel's comprehensive software toolset for designing
with all Actel FPGAs. From schematic and/or HDL design, synthesis and
simulation, through floorplanning, place-and-route, timing constraints and
analysis, power analysis, and program file generation, Libero IDE manages
the entire design flow quickly and efficiently.
Libero IDE provides full power optimization and analysis tools for Actel's
low-power
flash FPGA families, including IGLOO and ProASIC3L, the latest
addition to the ProASIC3 family. Product Features and Types Libero IDE
offers the latest and best-in-class FPGA development tools from leading
EDA vendors such as Mentor Graphics, SynaptiCAD, and Synplicity. These tools,
combined with Actel developed tools allow you to quickly and easily manage
your Actel FPGA designs. An intuitive user interface and powerful design
manager guides you through the process while organizing design files and
seamlessly managing exchanges between the various tools.
Libero IDE Software Features:
- Powerful project and design flow management
- Full suite of integrated design entry tools and methodologies:
- CoreConsole subsystem creation
- Core Catalog and Configuration
- ViewDraw Schematic Capture
- SmartDesign graphical block subsystem creation with automatic HDL
abstraction
- HDL and HDL templates
- "User-defined blocks" creation flow for design re-use
- Actel macro cells
- Synplify/Synplify Pro AE synthesis fully optimizes Actel FPGA device
performance and area utilization
- Synplify DSP AE performs high-level DSP optimizations within a Simulink
environment
- Test-bench generation including analog stimulus via WaveFormer Lite AE.
Advanced analog stimulus functionality is available from SynaptiCad.
- ModelSim VHDL or Verilog behavioral, post-synthesis and post-layout
simulation capability
- Designer physical design implementation, floorplanning, physical
constraints, and layout
- Timing- and power-driven place-and-route
- SmartTime environment for timing constraint management and analysis
- SmartPower provides comprehensive power analysis
- Interface to
flashPro and Silicon Sculptor programming software
- Identify AE debugging software for Actel
flash designs
- Silicon Explorer debugging software for Actel antifuse designs
- Supported on Windows and Linux operating systems
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